STM32F207中文数据手册(12)

7. 用一个真正的电阻串联一个可切换的PMOS/NMOS，组成上拉和下拉电阻。这个MOS/NMOS对于串联的电阻而言是很小的（~10%）。

8. 由设计保证，不在生产中测试。

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所有的I/O口都是CMOS和TTL兼容的（不需要软件配置）。他们的特性涵盖了严格的CMOS技术活TTL参数。

输出驱动电流

GPIO（通用输入/输出）能下落或起源高达±8 mA，并且下落或起源高达 ±20mA（带一个不受约束的VOL/VOH），除了PC13，PC14 和 PC15，这几个引脚能下落或起源高达±8 mA。当在输出模式中使用PC13到PC15GPIO时，速度不能超过2MHz，带有一个最大负载达30pF。

在用户应用程序中，能驱动电流的I/O引脚的数量必须被限制，以满足5.2节中指定的绝对最大额定值。

● 用VDD供电的所有I/O口的电流总和，加上由VDD供电的MCU最大运行功率，不能超过绝对最大额定值IVDD（见表10）。

● 在VSS上，流入所有I/O口的电流总和，加上在VSS上流入运行的MCU功率，不能超过绝对最大额定值IVSS（见表10）。

输出电压水平

除非另有说明，表45给出的参数来源于在表12总结的环境温度和VDD供电电压下的测试结果。所有I/O口都能兼容CMOS和TTL。

表45. 输出电压特性(1) （略）

1. 通过电源开关向PC13，PC14，PC15和PI8供电。由于这个开关只能流进有限的电流(3mA)，因此在输出模式下GPIO PC13~PC15和PI8引脚的使用是受限制的：速率不能超过2MHz，带最大负载30pF，以及这些I/O口不准作为一个电流源（e.g 驱动一个LED）。

2. 流进设备的IIO电流必须总是满足表10中指定绝对最大额定值，比企鹅IIO的总和（I/O端口和控制引脚）必须不超过IVSS。

3. 流出设备的IIO电流必须总是满足表10中指定的绝对最大额定值，比企鹅IIO的总和（I/O端口和控制引脚）必须不超过，IVDD。

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4. 基于特性数据，不在生产中测试。 输入/输出交流特征

图37和表46分别给出了输入/输出AC特性的定义和值。

除非另有说明，表46给吃的参数来源于在表12中总结的环境温度和VDD供电电压条件下测试的值。

表46. I/O AC特性(1)(2) （略）

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1. 用OSPEEDRy[1:0]位配置I/O速率。参考STM32F20/21xxx 参考手册，GPIOx_SPEEDR GPIO端口输出速率寄存器的描述。 2. TBD代表 “to be defined”。 3. 图37定义了最大频率

4. 对于高于50MHz的最大频率，需要一个补偿单元。 图37. I/O AC特性定义（略）

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5.3.17 NRST引脚特性

NRST引脚输入驱动使用了CMOS技术。它连接到了一个永久的上拉电阻，RPU（见表44）。

除非另有说明，表47中给出的参数来源于在表12所列的环境温度和VDD供电电压条件下的测试结果。

表47. NRST引脚特性（略）

1.由设计保证，不在生产中测试。

2. 用一个真正的电阻串联一个可切换的PMOS，组成上拉和下拉电阻。这个PMOS对于串联的电阻而言是很小的（~10%）。

图38. 推荐的NRST引脚保护（略） 2. 复位网络保护设备防止寄生复位。

3. 用户必须确保NRST引脚上的电平能够低于表47中指定的VIL（NRST）最大电平。否则复位将不会被设备考虑。

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5.3.1 TIM定时器特性

表48和表49中的参数由设计保证。

参阅5.3.16节：关于输入/输出交流函数特性的I/O端口特性的详细信息（输出比较，输入捕捉，外部时钟，PWM输出）。

表48. 连接到APB1区域的TIMx特性(1) （略）

1. TIMx用作TIM2，TIM3，TIM4，TIM5，TIM6，TIM7和TIM12定时器的通用术语。

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表49. 连接到APB2区域的TIMx的特性（略）

1. TIMx用作TIM1，TIM8，TIM9，TIM10和TIM11定时器的通用术语。 5.3.19 通信接口 I2C接口特性

除非特别说明，表50列出的参数是使用环境温度，fPCLK1频率和VDD供电电压符合表12的条件测量得到。

STM32F205xx和STM32F207xx产品的I2C接口符合标准I2C通信协议，但有如下限制：SDA和SCL不是”真”开漏的引脚，当配置为开漏输出时，在引出脚和VDD之间的PMOS管被关闭，但仍然存在。

I2C接口特性列于表50，有关输入输出复用功能引脚(SDA和SCL)的特性详情，参见第5.3.16节。

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表50. I2C特征（略）

1. 由设计保证，不在生产中测试。

2. 为达到标准模式I2C的最大频率，fPCLK1必须大于2MHz。为达到快速模式I2C的最大频率，fPCLK1必须大于4MHz，为达到400KHz的最大I2C快速模式时钟，fPCLK1必须是10MHz的倍数。

3. 如果不要求拉长SCL信号的低电平时间，则只需满足开始条件的最大保持时间。

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图39. I2C总线交流波形和测量电路（略）

1. 测量点设置于CMOS电平：0.3VDD和0.7VDD。

表51. SCL频率(fPCLK1= 30MHz，VDD= 3.3V)(1)(2) （略） 1. RP= 外部上拉电阻，fSCL=I2C速度。

2. 对于200kHz左右的速度，速度的误差是±5%。对于其它速度范围，速度的误差是±2%。这些变化取决于设计中外部元器件的精度。

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I2S-SPI接口特性

除非特别说明，表52列出的SPI参数和表53列出的I2S参数是使用环境温度，fPCLKx频率和VDD供电电压符合表12的条件测量得到。

有关输入输出复用功能引脚(SPI的NSS、SCK、MOSI、MISO，I2S的WS、CK、SD)的特性详情，参见第5.3.16节。

表52. SPI特性(1) （略）

1. 重映射的SPI1特性需要进一步确定。 2. 由综合评估得出，不在生产中测试。

3. 最小值表示驱动输出的最小时间，最大值表示正确获得数据的最大时间。

4. 最小值表示关闭输出的最小时间，最大值表示把数据线置于高阻态的最大时间。