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四路抢答器设计报告1

来源:网络收集 时间:2026-07-24
导读: 电 子 课 程 设 计 题 目: 抢答器电路设计 系 别: 电气与电子工程系 专 业: 自动化 姓 名: 学 号: 指导教师: 奥特曼 河南城建学院 2011年6月19日 一、设计目的 1、学习数字电路中的优先编码器、锁存器 、多谐振荡器、译码器、数据显示管 的综合应用。

电 子 课 程 设 计

题 目: 抢答器电路设计

系 别: 电气与电子工程系

专 业: 自动化 姓 名: 学 号: 指导教师: 奥特曼

河南城建学院

2011年6月19日

一、设计目的

1、学习数字电路中的优先编码器、锁存器 、多谐振荡器、译码器、数据显示管 的综合应用。 2、熟悉抢答器的工作原理

3、了解数字系统设计,调试及故障排除方法。

二、设计要求

1、四组参赛者进行抢答,当抢答组按下抢答按钮时,抢答器能准确的判断 出抢答者。

2、抢答器应具有互锁功能,及某组抢答后能自动封锁其他各组进行抢答。 3、抢答器应具有限时功能,及限制抢答时间、答题时间等,要求显示时间 数据。

4、系统具有一个总的复位开关。

三、电路的总体结构 1,方案比较 一, 方案一

1、电路的总体原理框图

抢答按钮 优先编码器电路 锁存器 译码器 显示电路 主持人控制开关 控制电路 秒脉冲产生电路 定时电路 译码器电路 显示电路

抢答电路选用优先编码器 74LS148 和锁存器 74LS297 来完成。该电路主要完

成两个功能:一是分辨出选手按键的先后,并锁存优先抢答者的编号,同时译码显示电路显示编号(显示电路采用七段数字数码显示管);二是禁止其他选手按键,其按键操作无效。

定时电路原理及设计:该部分主要由555定时器秒脉冲产生电路、十进制同步加减计数器74LS192减法计数电路、74LS48译码电路和1个7段数码管即相关电路组成。具体电路如图所示。一块74LS192实现减法计数,通过译码电路74LS48显示到数码管上,其时钟信号由时钟产生电路提供。按键弹起后,计数器开始减法计数工作,并将时间显示在七段数码显示管上,当有人抢答时,停止计数并显示此时的倒计时时间;如果没有人抢答,且倒计时时间到时, 输出低电平到时序控制电路,同时以后选手抢答无效。结合我们的实际经验及考虑到元器件的成本,我们选择的电阻值为R1=15K,R2=68K,C=10uF,代入到上式中即得 ,即秒脉冲。

二, 方案二

抢答电路:使用74ls175作为锁存电路,当有人抢答时, 利用锁存器的输出信号号将时钟脉冲置零,74ls175立即被锁存,这时抢答无效,使用74ls148作为编码器,对输入的型号进行编码,输出4位的BCD码,再将这四位的BCD码输入共阴数码管里显示出抢答者的编号。

主持人电路:;利用74ls190计数器作为倒计时的芯片,当主持人按下抢答按钮时,74ls190被置九,同时将显示上次抢到题目的选手编号的数码管清零,并开始倒计时,,并通过74ls48编码器将即时时间进行编码,并送到7段共阴数码管,显示此时的时间。假如在9秒内有人抢答,则计数器停止倒计时,将锁存器锁存,禁止选手抢答,停止倒计时。

方案更加简洁,易行而且使用到的元器件也都是我们常用到的一些元件,比如,555,74ls148以及开关电容电阻与方案二比较闲的更简单明了。 这里我们选择方案一

2,单元电路设计 (1)抢答电路设计

设计电路如图所示。电路选用优先编码器 74LS148 和锁存器 74LS297 来完

成。该电路主要完成两个功能:一是分辨出选手按键的先后,并锁存优先抢答者的编号,同时译码显示电路显示编号(显示电路采用七段数字数码显示管);二是禁止其他选手按键,其按键操作无效。

工作过程:开关S接地端时,74LS279D输出置0,使74LS148的优先编码工作标志端(图中5号端)=0,使之处于工作状态。当开关S置于key=space时,抢答器处于等待工作状态,当有选手将抢答按键按下时(如按下第四个开关时),74LS148的输出经74LS279锁存后,CTR=1,RBO(图中4端) =1,七段显示电路74LS48处于工作状态,4Q3Q2Q=100,经译码显示为“4”。此外,CTR=1,使74LS148 优先编码工作标志端(图中5号端)=1,处于禁止状态,封锁其他

按键的输入。当按键松开即按下时,74LS148的 此时由于仍为CTR=1,使优先编码工作标志端(图中5号端)=1,所以74LS148仍处于禁止状态,确保不会出二次按键时输入信号,保证了抢答者的优先性。如有再次抢答需由主持人将S开关重新置地端然后再进行下一轮抢答。74LS148为8线-3线优先编码器,下表为其功能表。

(2)定时电路设计

节目主持人根据抢答器的难易程度,设计一次抢答的时间,通过预置时间电路对计数器进行预置,选用十进制同步加减计数器74LS192进行设计,计数器的时钟脉冲由秒脉冲电路提供。具体电路如图。

原理及设计:该部分主要由555定时器秒脉冲产生电路、十进制同步加减计数器74LS192减法计数电路、74LS48译码电路和1个7段数码管即相关电路组成。具体电路如图所示。一块74LS192实现减法计数,通过译码电路74LS48显示到数码管上,其时钟信号由时钟产生电路提供。按键弹起来后,计数器开始减法计数工作,并将时间显示在共阴极七段数码显示管上,当有同学抢答时,停止计数并显示此时的倒计时时间;如果没有人抢答,且倒计时时间到时, 输出低电平到时序控制电路,同时以后选手抢答无效。结合我们的实际经验及考虑到元器件的成本,我们选择的电阻值为R1=15K,R2=68K,C=10uF,代入到上式中即得 ,即秒脉冲。

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